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        編碼裝置、解碼裝置、編碼方法、解碼方法和存儲介質與流程

        文檔序號:45273127發布日期:2026-04-17 20:15閱讀:6來源:國知局

        本公開涉及視頻編碼,特別涉及運動圖像的編碼以及解碼中的系統、構成要素以及方法等。


        背景技術:

        1、視頻編碼技術從h.261和mpeg-1進步到h.264/avc(advanced?video?coding:高級視頻編碼)、mpeg-la、h.265/hevc(high?efficiency?video?coding:高效視頻編碼)和h.266/vvc(versatile?video?codec:通用視頻編解碼器)。伴隨著該進步,為了處理在各種用途中持續增加的數字視頻數據量,始終需要提供視頻編碼技術的改良以及最優化。本公開涉及視頻編碼中的進一步的進步、改良以及最優化。

        2、此外,非專利文獻1涉及與上述的視頻編碼技術相關的現有的標準的一例。

        3、現有技術文獻

        4、非專利文獻

        5、非專利文獻1:h.265(iso/iec?23008-2?hevc)/hevc(high?efficiency?videocoding)


        技術實現思路

        1、發明要解決的課題

        2、關于上述那樣的編碼方式,為編碼效率的改善、畫質的改善、處理量的削減、電路規模的削減、或者濾波器、塊、尺寸、運動矢量、參照圖片或參照塊等要素或動作的適當的選擇等,期望提出新的方式。

        3、本公開提供一種能夠對例如編碼效率的改善、畫質的改善、處理量的削減、電路規模的削減、處理速度的改善以及要素或動作的適當的選擇等中的1個以上做出貢獻的結構或方法。此外,本公開可以包含能夠有助于上述以外的利益的結構或方法。

        4、用于解決課題的手段

        5、例如,本公開的一形態的編碼裝置具備電路和與所述電路連接的存儲器,所述電路在動作中,在id表示多個時間子層中包含的最上位時間子層以外的下位時間子層的情況下,為了計算所述下位時間子層中的圖片的dpb(decoded?picture?buffer,解碼圖片緩沖區)輸出時間[id],從所述多個時間子層中共同的dpb輸出延遲減去對每個時間子層設置的dpb輸出差量[id],在maxid表示所述最上位時間子層的情況下,通過從cpb(coded?picturebuffer,編碼圖片緩沖區)除去延遲[id]減去cpb除去延遲[maxid]及偏移[id]來計算所述dpb輸出差量[id],將所述偏移[id]保存于比特流,所述電路通過減去所述偏移[id],計算dpb輸出延遲[maxid]以下的值作為所述dpb輸出差量[id],所述電路將所述偏移[id]寫入所述比特流中的緩沖周期sei消息。

        6、本公開中的各實施方式或其一部分的結構或方法分別例如能夠實現編碼效率的改善、畫質的改善、編碼/解碼的處理量的削減、電路規模的削減、或編碼/解碼的處理速度的改善等中的至少任意1個。或者,本公開中的各實施方式或者其一部分的結構或者方法分別在編碼以及解碼中,能夠進行濾波器、塊、尺寸、運動矢量、參照圖片、參照塊等的構成要素/動作的適當的選擇等。另外,本公開還包括能夠提供上述以外的利益的結構或方法的公開。例如,是在抑制處理量的增加的同時改善編碼效率的結構或方法等。

        7、根據說明書以及附圖,對本公開的一形態中的進一步的優點以及效果進行了明確。該優點和/或效果通過幾個實施方式以及說明書和附圖中記載的特征而分別得到,但為了得到1個或其以上的優點和/或效果,未必需要全部提供。

        8、此外,這些總括性或者具體的形態可以通過系統、集成電路、計算機程序或計算機可讀取的cd-rom等記錄介質來實現,也可以通過系統、方法、集成電路、計算機程序以及記錄介質的任意組合來實現。

        9、發明效果

        10、本公開的一形態的結構或者方法例如能夠對編碼效率的改善、畫質的改善、處理量的削減、電路規模的削減、處理速度的改善以及要素或動作的適當的選擇等中的1個以上做出貢獻。另外,本公開的一形態的結構或方法也可以對上述以外的利益做出貢獻。


        技術特征:

        1.一種編碼裝置,其中,具備:

        2.一種解碼裝置,其中,具備:

        3.一種編碼方法,其中,

        4.一種解碼方法,其中,

        5.一種非暫時性存儲介質,保存比特流,其中,


        技術總結
        編碼裝置、解碼裝置、編碼方法、和解碼方法和存儲介質。編碼裝置(100)具備電路和與電路連接的存儲器,電路在id表示多個時間子層中包含的最上位時間子層以外的下位時間子層的情況下,計算下位時間子層中的圖片的DPB輸出時間[id](S201)。在步驟S201中,編碼裝置100的電路從多個時間子層中共同的DPB輸出延遲減去對每個時間子層設置的DPB輸出差量[id],在maxid表示最上位時間子層的情況下,通過從CPB除去延遲[id]減去CPB除去延遲[maxid]及偏移[id]來計算DPB輸出差量[id]。接著,電路將偏移[id]保存于比特流(S202),通過減去所述偏移[id],計算DPB輸出延遲[maxid]以下的值作為所述DPB輸出差量[id],將所述偏移[id]寫入所述比特流中的緩沖周期SEI消息。

        技術研發人員:V·德呂容,安倍清史,西孝啟,遠間正真
        受保護的技術使用者:松下電器(美國)知識產權公司
        技術研發日:
        技術公布日:2026/4/16
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